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用于高速 DRAM 接口的 32Gb/s 基于时间的 PAM-4 收发器，具有现场通道丢失和误码率监控功能
IEEE Transactions on Circuits and Systems I: Regular Papers ( IF 5.2 ) Pub Date : 2022-01-28 , DOI: 10.1109/tcsi.2022.3143876 Po-Wei Chiu 1 , Chris H. Kim 1
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采用 65 nm GP CMOS 工艺演示了具有 2 抽头基于时间的决策反馈均衡 (TB-DFE) 电路的数字密集型四级脉冲幅度 (PAM-4) 收发器。与之前基于时间的 DFE 方法相比，新型基于逆变器的差分电压时间转换器 (DVTC) 提高了线性度和动态范围，从而实现了可靠的 PAM-4 操作。四级信号比较和 DFE 操作完全在时域中使用可编程延迟和相位检测器 (PD) 进行。使用片上误码率 (BER) 监视器，我们验证了 BER 小于 10 −12 ，同时在 32Gb/s 数据速率下实现了 0.97pJ/b 的能效。发送器(TX)和接收器(RX)电路占据0.009mm 2的面积。
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